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IT CookBook, Circuit Design with VHDL : VHDL을 이용한 디지털 회로 설계

IT CookBook, Circuit Design with VHDL : VHDL을 이용한 디지털 회로 설계

한빛아카데미

번역서

절판

  • 저자 : 볼네이 페드로니(Volnei A. Pedroni)
  • 번역 : 김은성
  • 출간 : 2009-12-04
  • 페이지 : 384 쪽
  • ISBN : 9788979147162
  • 물류코드 :1716
  • 본 도서는 대학 강의용 교재로 개발되었으므로 연습문제 해답은 제공하지 않습니다.
  • 초급 초중급 중급 중고급 고급
4점 (1명)
좋아요 : 22

VHDL 완전 소스부터 시뮬레이션 결과까지 직접 구현하고 결과를 눈으로 확인한다!

이 책에서는 VHDL을 이용한 디지털 회로의 기본 개념뿐만 아니라, 기본적인 코딩 기술과 광범위한 시스템 설계 예제를 다루어 물리적으로 직접 구현해 볼 수 있도록 하였다. 또한 각 설계 예제에 대한 시뮬레이션 결과를 보여주어 직접 확인해 볼 수 있다. 이러한 독창적인 접근법은 VHDL과 PLD, 디지털 설계 등을 학습하고자 하는 전기, 전자, 정보통신, 컴퓨터공학 분야 학생 및 엔지니어에게 큰 도움이 될 것이다. 이론적인 디지털 설계 개념에만 국한하지 않고, 실습을 통해 결과를 눈으로 확인해 볼 수 있는 설계 지향적 방식으로 전개하였다.

  • 01장 : VHDL이란│설계 흐름│EDA 도구│VHDL 코드를 회로로 변환
  • 02장 : 기본적인 VHDL 단위│라이브러리 선언│ENTITY│ARCHITECTURE
  • 03장 : 기정의된 데이터 타입│사용자 정의 데이터 타입│서브타입│포트 배열│레코드│SIGNED와 UNSIGNED 데이터 타입│데이터 변환
  • 04장 : 연산자와 속성│사용자 정의 속성│연산자 오버로딩│GENERIC 문
  • 05장 : WHEN 문│ GENERATE 문│BLOCK 문
  • 06장 : PROCESS 문│IF 문│WAIT 문│CASE 문│LOOP 문│조합 회로 설계를 위한 순차 코드의 사용
  • 07장 : CONSTANT│SIGNAL│VARIABLE│레지스터 수
  • 08장 : 상태 기계│설계 스타일│인코딩 스타일
  • 09장 : 배럴 시프터│유부호 비교기와 무부호 비교기│캐리 리플 덧셈기와 캐리 예측 덧셈기│고정 소수점 나눗셈│자동판매기 제어기│직렬 데이터 수신기│병렬-직렬 변환기│SSD를 가지고 하는 게임│신호 발생기│메모리 설계
  • 10장 : PACKAGE│COMPONENT│PORT MAP│GENERIC MAP
  • 11장 : FUNCTION│함수의 위치│PROCEDURE│프로시저의 위치│ASSERT
  • 12장 : 직병렬 곱셈기│병렬 곱셈기│곱셈-누적 회로│디지털 필터│신경회로망
볼네이 페드로니(Volnei A. Pedroni) 저자

볼네이 페드로니(Volnei A. Pedroni)

저자는 미국 캘리포니아 공과대학(Caltech)에서 전기공학과 박사학위를 취득하였다. 현재 브라질의 UTFPR(Federal University of Technology - Paraná)에서 전자공학과 교수로 재직 중이다. 주관심 분야는 마이크로전자공학, VLSI 설계 등이며, 저서로는 『Digital Electronics and Design with VHDL』(Morgan Kaufmann, 2008)이 있다.

김은성 역자

김은성

현재 순천향대학교 전기전자공학과 교수로 재직 중이다. 컴퓨터 아키텍처 관련 주제로 1989년에 한양대학교에서 박사학위를 취득하였다. 2000년부터 2년 동안 미국 노스이스턴대학교(Northeastern University) 전기․컴퓨터공학과 객원교수로 재직하였으며, 1989년부터 순천향대학교에서 강의를 하고 있다. 고성능 마이크로프로세서 설계, 임베디드 시스템, RFID, 센서 네트워크 등을 연구하고 있다. 저서로는 『예제로 배우는 객체지향 프로그래밍』(사이텍미디어, 2009)이 있고, 역서로는 『VHDL을 이용한 디지털 회로 입문』(한빛미디어, 2009)이 있다.

Part 1 회로 설계

1장 | 서론
01_ VHDL이란
02_ 설계 흐름
03_ EDA 도구
04_ VHDL 코드를 회로로 변환
05_ 설계 예

2장 | 코드 구성
01_ 기본적인 VHDL 단위 
02_ 라이브러리 선언
03_ ENTITY
04_ ARCHITECTURE
05_ 기본 예
연습문제

3장 | 데이터 타입
01_ 기정의된 데이터 타입   
02_ 사용자 정의 데이터 타입
03_ 서브타입
04_ 배열
05_ 포트 배열  
06_ 레코드 
07_ SIGNED와 UNSIGNED 데이터 타입 
08_ 데이터 변환 
09_ 요약 
10_ 그 밖의 예      
연습문제

4장 | 연산자와 속성
01_ 연산자
02_ 속성
03_ 사용자 정의 속성
04_ 연산자 오버로딩
05_ GENERIC 문
06_ 완전한 설계 예 
07_ 요약 
연습문제

5장 | 병행 코드
01_ 병행 대 순차
02_ 연산자 사용하기
03_ WHEN 문(단순형과 선택형)
04_ GENERATE 문
05_ BLOCK 문
연습문제

6장 | 순차 코드
01_ PROCESS 문
02_ 신호와 변수
03_ IF 문
04_ WAIT 문
05_ CASE 문
06_ LOOP 문
07_ CASE 문 대 IF 문 
08_ CASE 문 대 WHEN 문 
09_ 잘못된 클록 사용 
10_ 조합 회로 설계를 위한 순차 코드의 사용 
연습문제

7장 | 신호와 변수
01_ CONSTANT 
02_ SIGNAL
03_ VARIABLE 
04_ SIGNAL 대 VARIABLE
05_ 레지스터 수
연습문제
 
8장 | 상태 기계
01_ 서론
02_ 설계 스타일 #1     
03_ 설계 스타일 #2 (저장되는 출력)
04_ 인코딩 스타일: 이진 코드부터 OneHot까지
연습문제

9장 | 그 밖의 회로 설계
01_ 배럴 시프터             
02_ 유부호 비교기와 무부호 비교기
03_ 캐리 리플 덧셈기와 캐리 예측 덧셈기         
04_ 고정 소수점 나눗셈
05_ 자동판매기 제어기
06_ 직렬 데이터 수신기
07_ 병렬-직렬 변환기
08_ SSD를 가지고 하는 게임
09_ 신호 발생기
10_ 메모리 설계
연습문제

Part 2 시스템 설계

10장 | 패키지 및 부품
01_ 서론 
02_ PACKAGE
03_ COMPONENT
04_ PORT MAP
05_ GENERIC MAP
연습문제
 
11장 | 함수와 프로시저
01_ FUNCTION
02_ 함수의 위치
03_ PROCEDURE
04_ 프로시저의 위치
05_ FUNCTION과 PROCEDURE의 요약
06_ ASSERT 
연습문제

12장 | 그 밖의 시스템 설계
01_ 직병렬 곱셈기
02_ 병렬 곱셈기
03_ 곱셈-누적 회로
04_ 디지털 필터
05_ 신경회로망
연습문제

부록 A_ 프로그램 가능 논리 소자
부록 B_ Xilinx ISE + ModelSim 설명서
부록 C_ Altera Quartus II 설명서
부록 D_ VHDL 예약어

찾아보기

책의 구성은 흠잡을때 없이 좋지만
기본 적인 설명이 약간 부족하여 학생들이 예제를 푸는데
어려움이 있음. 전체적으로 봐서 설명이 부족한 것을 빼면
책의구성이라든지 여러가지 면으로 봐서 참 괜찮은 책임

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